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3 年
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実験室/CLBsの数
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3840
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論理素子/細胞の数
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34560
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総RAMビット
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3538944
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入力/出力の数
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448
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電圧-供給
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1.14V | 1.26V
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タイプの取付け
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実用温度
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0°C | 85°C （TJ）
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パッケージ/場合
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製造者装置パッケージ
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668-FCBGA （27x27）
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基礎プロダクト数
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特徴
•Xesium™の時計の技術
- デジタル時計のマネージャー（DCM）のブロック
- 付加的な段階一致させた時計のディバイダー（PMCD）
- 差動全体的な時計
•XtremeDSP™の切れ
- 18 x 18のtwoの補足物は、乗数に署名した
- 任意パイプラインの段階
- 作り付け蓄積装置（48ビット）および加算機/減数
•スマートなランダム アクセス メモリ階層
- 分散RAM
- デュアル ポート18-Kbit RAMのブロック
·任意パイプラインの段階
·任意プログラム可能な先入れ先出し法の論理は先入れ先出し法信号として自動的にRAM信号を再配置する
- 高速記憶インターフェイスはDDRおよびDDR-2 SDRAM、QDR-IIおよびRLDRAM-IIを支える。
•SelectIO™の技術
- 3.3V入力/出力操作への1.5V
- ChipSync™の作り付けの源同期技術
- ディジタル式のインピーダンス（DCI）活動的な終了
- 良い粒状入力/出力の銀行業（1つの銀行の構成）
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