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実験室/CLBsの数
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896
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論理素子/細胞の数
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8064
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総RAMビット
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368640
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入力/出力の数
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251
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ゲートの数
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400000
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電圧-供給
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1.14V | 1.26V
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タイプの取付け
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実用温度
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0°C | 85°C （TJ）
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パッケージ/場合
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製造者装置パッケージ
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320-FBGA （19x19）
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基礎プロダクト数
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XC3S400A-4FGG320C
•複数の電圧、multi-standard SelectIO™インターフェイス ピン
•502までの入力/出力ピンか227の差分信号の組
•LVCMOS、LVTTL、HSTLおよびSSTL片端接地入力/出力
•3.3V、2.5V、1.8V、1.5Vおよび1.2Vシグナリング
•選択可能な出力ドライブ、ピンごとの24までmA
•QUIETIOの標準は入力/出力の転換の騒音を減らす
•完全な3.3V ± 10%の両立性およびホット スワップ承諾
•差動入力/出力ごとの640+ Mb/sのデータ転送率
•LVDS、ミニLVDS RSDS統合された差動終了の抵抗器を搭載するHSTL/SSTL差動入力/出力
•高められた二重データ転送速度（DDR）サポート
•DDR/DDR2 SDRAMサポート400までMb/s
•完全に準拠した32 /64ビット、技術サポート33/66のMHzのPCI®の
•豊富で、適用範囲が広い論理資源
•密度任意シフト レジスタまたは分散RAMサポートを含む25,344個までの論理の細胞、
•有効で広い多重交換装置、広い論理
•速い先読みは論理を運ぶ
•任意パイプラインとの高められた18 x 18の乗数
•IEEE 1149.1/1532 JTAGの/港をデバッグするためプログラミング
•階層的なSelectRAM™の記憶建築
•バイトの速いブロックのRAMの576までKbitsプロセッサの塗布のために可能になる書く
•有効な分散RAMの176までKbits
•8人までのデジタル時計のマネージャー（DCMs）
•時計の斜めの除去（遅れのロックされた ループ）
•頻度統合、乗法、分割
•高解像段階の転移
•広い周波数範囲（5つのMHzへの320以上のMHz）
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