EP4SGX530KH40C4N 744入力/出力21248の実験室ALTERA FPGAの破片
型式番号:EP4SGX530KH40C4N
最低順序量:1 PCS
支払の言葉:T/T、ウェスタン・ユニオン、Paypalの貿易保証、クレジット カード
供給の能力:120 PC
受渡し時間:3-5日
包装の細部:国際規格の包装
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正会員
Shenzhen Guangdong China
住所：
R1811、B BldgのJiaheタワー、No.3006 Shennan中間Rd、シンセン、中国
サプライヤーの最後のログイン時間:
内 27 時間
製品詳細
会社概要
製品詳細
EP4SGX530KH40C4N ALTERA FPGAの破片BGA-1517 744入力/出力Stratix IV GX
| 製品特質 | 属性値 |
|---|---|
| Intel | |
| FPGA -システム内プログラム可能なゲート・アレー | |
| Stratix IV GX | |
| 531200 | |
| 21248 | |
| 744入力/出力 | |
| 900 mV | |
| 0 C | |
| + 70 C | |
| SMD/SMT | |
| BGA-1517 | |
| 皿 | |
| データ転送速度: | 600 Mb/sから8.5 Gb/s |
| シリーズ: | Stratix IV GX |
| ブランド: | Intel/Altera |
| 最高の動作周波数: | 600のMHz |
| 敏感な湿気: | はい |
| トランシーバーの数: | 36トランシーバー |
| 製品タイプ: | FPGA -システム内プログラム可能なゲート・アレー |
| 工場パックの量: | 12 |
| 下位範疇: | プログラム可能な論理IC |
| 総記憶: | 27376 kbit |
| 商号: | Stratix |
| 部分#別名: | 974500 |
Stratix IV装置家族は異なったアプリケ−ション使用要件を満たすために3つの最大限に活用された変形を含んでいる:
■Stratix IV
GXの48までの双方向通信の司令官ベースのトランシーバーおよびデータ転送速度を支えるGT装置8.5までGbpsおよび11.3
Gbps、それぞれ
■普及した連続議定書のための物理層の機能性を、PCI明白な（PCIe） （管） Gen1およびGen2のような支える専用されていた回路部品Gbpsのイーサネット（GbE）、
連続RapidIO、SONET/SDH、XAUI/HiGig、（OIF） CEI-6G、SD/HD/3G-SDI、繊維チャネル、SFI-5およびインターラーケン
■PHY-MACの層、データ リンク層およびトランザクション層の機能性実行する埋め込まれたPCIe堅いIPのブロックが付いている完全なPCIeの議定書の解決
■プログラム可能な送信機の前重点および物理的な媒体のfrequency-dependent損失を補う受信機の同等化の回路部品
■3.125 Gbpsの100 MWおよびチャネルごとの6.375 Gbpsの135 MWの典型的で物理的な中型の付属品（PMA）のパワー消費量
■72,600への装置ごとの813,050同等のLEs
■本当のデュアル ポートの記憶および先入れ先出し法の緩衝を実行する3つのRAMのブロック サイズから成っているTriMatrixの高められた記憶の7,370から33,294 Kb
■9つのx 9ビット、12のx 12ビット、18のx 18ビットおよび600までのMHzで36のx 36ビット全精密乗数として構成可能高速デジタル信号処理の（DSP）ブロック
■普及した連続議定書のための物理層の機能性を、PCI明白な（PCIe） （管） Gen1およびGen2のような支える専用されていた回路部品Gbpsのイーサネット（GbE）、
連続RapidIO、SONET/SDH、XAUI/HiGig、（OIF） CEI-6G、SD/HD/3G-SDI、繊維チャネル、SFI-5およびインターラーケン
■PHY-MACの層、データ リンク層およびトランザクション層の機能性実行する埋め込まれたPCIe堅いIPのブロックが付いている完全なPCIeの議定書の解決
■プログラム可能な送信機の前重点および物理的な媒体のfrequency-dependent損失を補う受信機の同等化の回路部品
■3.125 Gbpsの100 MWおよびチャネルごとの6.375 Gbpsの135 MWの典型的で物理的な中型の付属品（PMA）のパワー消費量
■72,600への装置ごとの813,050同等のLEs
■本当のデュアル ポートの記憶および先入れ先出し法の緩衝を実行する3つのRAMのブロック サイズから成っているTriMatrixの高められた記憶の7,370から33,294 Kb
■9つのx 9ビット、12のx 12ビット、18のx 18ビットおよび600までのMHzで36のx 36ビット全精密乗数として構成可能高速デジタル信号処理の（DSP）ブロック
EP4SGX530KH40C4N 744入力/出力21248の実験室ALTERA FPGAの破片
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