EPM570T144C5N プログラム可能な fpga CPLD 複雑なプログラム可能な論理装置 2.5 V 3.3 VTQFP-144

EPM570T144C5N プログラム可能な fpga CPLD 複雑なプログラム可能な論理装置 2.5 V 3.3 VTQFP-144

記述:

MAX® IIファミリーの瞬時に点滅する不揮発性CPLDは,0.18μmの6層金属フラッシュプロセスに基づいており,240から2,210の論理要素 (LE) (128から2,210 相当 マクロセル) と 8 Kbits の非揮発性ストレージ. MAX IIデバイスは,他のCPLDアーキテクチャと比較して高いI/Oカウント,高速なパフォーマンス,信頼性の高いフィッティングを提供しています.マルチボルトコア,ユーザーフラッシュメモリ (UFM) ブロック,システム内のプログラム可能性 (ISP)MAX IIデバイスは,バスブリッジ,I/O拡張,電源再セット (POR) およびシーケンシング制御などのアプリケーションのためのプログラム可能なソリューションを提供しながら,コストと電力を削減するように設計されています.装置の設定制御.

特徴:

MAX II CPLDには以下の特徴がある.

■ 低コストで低消費量のCPLD

■ 瞬時に起動し,不変なアーキテクチャ

■ 待機電流は25 μA以下

■ 迅速な伝播遅延とクロック・トゥ・アウトプット時間

■ 論理配列ブロック (LAB) に 2 つの時計が利用可能な 4 つのグローバルクロックを提供します

■ UFM ブロック 8 Kbits まで 非 揮発性 ストレージ

■ 3,3V/2,5Vまたは1,8Vのデバイスへの外部電源電圧を可能にするマルチボルトコア

■ 3.3-V,2.5-V,1.8-V,1.5-V の論理レベルをサポートするマルチボルト I/O インターフェース

■ プログラム可能なスレウレート,駆動強度,バスホルダー,プログラム可能なプルアップレジスタを含むバスに適したアーキテクチャ

■ 騒音耐性のある入力 (ピンごとにプログラム可能) を可能にするシュミットトリガー

■ I/O は,6.6MHz の3.3V 動作のためのPCI局所バス仕様,修正 2.2 に完全に適合しています.

■ ホットソケット対応

■ IEEE Std.1149.1-1990 に準拠する,組み込み合同テストアクショングループ (JTAG) の境界スキャンテスト (BST) 回路

■ IEEE Std. 1532 に準拠する ISP 回路

日付表:

交通費と支払い

よくある質問

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