FPGAsのプログラム可能な論理IC 1.05VをプログラムするXC7S50-1FGGA484I ICの破片
型式番号:XC7S50-1FGGA484I
原産地:原物
最低順序量:1
支払の言葉:L/C、D/A、D/P、T/T、ウェスタン・ユニオン、MoneyGram
供給の能力:999999
受渡し時間:1～3日
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確認済みサプライヤー
Shenzhen China
住所：
1702, Dingcheng international building, Zhonghang Road, Futian District, Shenzhen
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内 38 時間
製品詳細
会社概要
製品詳細
XC7S50-1FGGA484Iプログラム可能なICの破片484-FPBGAのパッケージのシステム内プログラム可能なゲート・アレー
実験室/CLBsの数 | 4075 | |
論理素子/細胞の数 | 52160 | |
総RAMビット | 2764800 | |
入力/出力の数 | 250 | |
電圧-供給 | 0.95V | 1.05V | |
タイプの取付け | ||
実用温度 | -40°C | 100°C （TJ） | |
パッケージ/場合 | ||
製造者装置パッケージ | 484-FPBGA （23x23） | |
基礎プロダクト数 |
XC7S50-1FGGA484I
•DDR3インターフェイスのためのサポートとのSelectIO™の高性能技術1,866までMb/s。
•600 Mb/sからの最高への作り付け複数のギガビットのトランシーバーとの高速連続結合性。chip-to-chipインターフェイスのために最大限に活用される特別なローパワー モードを提供する6.6 Gb/sの率28.05までGb/s。
•ユーザーの構成可能のアナログ インターフェース（XADC）、オン破片の上昇温暖気流および供給センサーが付いている織込んでいる二重12ビット1MSPSアナログ・ディジタル変換器。
•25 x 18乗数、最大限に活用された対称的な係数のろ過を含んで高性能ろ過のための48ビット蓄積装置および前加算機が付いているDSPの切れ。
•強力な時計管理タイル（CMT）、phase-lockedループ（PLL）および高精度および低いジッターのためのミックス モードの時計マネージャーの（MMCM）ブロックを結合する。
•すぐに埋め込まれた処理をMicroBlaze™プロセッサと配置するため。
•x8 Gen3の終点および根の港の設計までののPCI Express® （PCIe）のための統合されたブロック。
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FPGAsのプログラム可能な論理IC 1.05VをプログラムするXC7S50-1FGGA484I ICの破片
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