電力プログラマブル IC チップ XC6SLX100-3FGG484C Spartan-6 ファミリの概要

電力プログラマブル IC チップ XC6SLX100-3FGG484C Spartan-6 ファミリの概要

XC6SLX100-3FGG484CSpartan-6 ファミリの概要

概要

Spartan®-6 ファミリは、大容量アプリケーションに最小限の総コストで最先端のシステム統合機能を提供します。13 メンバーのファミリーは、3,840 ～ 147,443 個のロジック セルの範囲で拡張された密度を実現し、以前の Spartan ファミリの半分の消費電力と、より高速でより包括的な接続を実現します。Spartan-6 ファミリは、コスト、電力、パフォーマンスの最適なバランスを実現する成熟した 45 nm 低消費電力銅プロセス テクノロジーに基づいて構築されており、より効率的な新しいデュアル レジスタ 6 入力ルックアップ テーブル (LUT) ロジックと豊富な組み込みシステムレベルブロック。これらには、18 Kb (2 x 9 Kb) ブロック RAM、第 2 世代 DSP48A1 スライス、SDRAM メモリ コントローラー、強化された混合モード クロック管理ブロック、SelectIO™ テクノロジー、電力最適化された高速シリアル トランシーバー ブロック、PCI Express® 互換エンドポイント ブロック、高度なシステムレベルの電源管理モード、自動検出構成オプション、AES およびデバイス DNA 保護による強化された IP セキュリティ。これらの機能は、前例のない使いやすさを備えた、カスタム ASIC 製品に代わる低コストのプログラム可能な代替製品を提供します。Spartan-6 FPGA は、大容量ロジック デザイン、消費者向け DSP デザイン、コスト重視の組み込みアプリケーションに最適なソリューションを提供します。Spartan-6 FPGA は、ターゲット デザイン プラットフォーム用のプログラマブル シリコン基盤であり、統合されたソフトウェアおよびハードウェア コンポーネントを提供するため、設計者は開発サイクルが始まるとすぐにイノベーションに集中できます。Spartan-6 FPGA の概要

特徴

• Spartan-6 ファミリ:

• Spartan-6 LX FPGA: 最適化されたロジック

• Spartan-6 LXT FPGA: 高速シリアル接続

• 低コスト向けの設計

• 複数の効率的な統合ブロック

• I/O規格の最適化された選択

• 千鳥状パッド

• 大量生産のプラスチックワイヤボンディングパッケージ

• 静的および動的消費電力が低い

• コストと低消費電力を最適化した 45 nm プロセス

• 電力ゼロの休止状態パワーダウンモード

• サスペンド モードは、マルチピン ウェイクアップ、制御強化により状態と構成を維持します。

• 低電力 1.0V コア電圧 (LX FPGA、-1L のみ)

• 高性能 1.2V コア電圧 (LX および LXT FPGA、-2、-3、および -4 スピード グレード)

• マルチ電圧、マルチスタンダード SelectIO™ インターフェイス バンク

• 差動 I/O あたり最大 1,050 Mb/s のデータ転送速度

• 選択可能な出力ドライブ、ピンあたり最大 24 mA

• 3.3V ～ 1.2VI/O の規格およびプロトコル

• 低コストの HSTL および SSTL メモリ インターフェイス

• ホットスワップ準拠

• 調整可能な I/O スルーレートにより信号の完全性を向上

• LXT FPGA の高速 GTP シリアル トランシーバー

• 最大 3.125 Gb/秒

• 高速インターフェース

含む: Serial ATA、Aurora、1G Ethernet、PCI Express、OBSAI、CPRI、EPON、GPON、DisplayPort、および XAUI • PCI Express 設計用の統合エンドポイント ブロック (LXT) • 33 MHz、32 MHz と互換性のある低コストの PCI® テクノロジ サポート- および 64 ビット仕様。• 効率的な DSP48A1 スライス • 高性能の算術演算および信号処理 • 高速 18 x 18 乗算器および 48 ビット アキュムレータ • パイプラインおよびカスケード機能 • フィルタ アプリケーションを支援する前置加算器 • 統合メモリ コントローラ ブロック • DDR、DDR2、DDR3、および LPDDRサポート • 最大 800 Mb/s (ピーク帯域幅 12.8 Gb/s) のデータ レート • 設計タイミングの問題を軽減する独立した FIFO を備えたマルチポート バス構造 • 増加したロジック容量による豊富なロジック リソース • オプションのシフト レジスタまたは分散 RAM のサポート • 効率的6 入力 LUT によりパフォーマンスが向上し、消費電力が最小限に抑えられます。 • パイプライン中心のアプリケーション向けのデュアル フリップフロップを備えた LUT • 幅広い粒度のブロック RAM • バイト書き込みイネーブル付きの高速ブロック RAM • オプションで 2 つの独立した 9 ブロックとしてプログラムできる 18 Kb ブロックKb ブロック RAM • クロック管理タイル (CMT) によるパフォーマンスの向上 • 低ノイズ、柔軟なクロッキング • デジタル クロック マネージャー (DCM) によるクロック スキューとデューティ サイクル歪みの排除 • 低ジッター クロッキングのためのフェーズ ロック ループ (PLL) • による周波数合成乗算、除算、および位相シフトを同時に実行可能 • 16 個の低スキュー グローバル クロック ネットワーク • 簡素化された構成、低コスト標準をサポート • 2 ピン自動検出構成 • 幅広いサードパーティ製 SPI (最大 x4) および NOR フラッシュ サポート • 機能JTAG を備えた豊富なザイリンクス プラットフォーム フラッシュ • ウォッチドッグ保護を使用した、複数のビットストリームによるリモート アップグレードのためのマルチブート サポート • デザイン保護のための強化されたセキュリティ • デザイン認証のための一意のデバイス DNA 識別子 • 大型デバイスでの AES ビットストリーム暗号化 • 強化された低コストによる組み込み処理の高速化、MicroBlaze™ ソフト プロセッサ • 業界をリードする IP およびリファレンス デザイン

Spartan-6 FPGA 機能の概要

表 1 : デバイス別の Spartan-6 FPGA 機能の概要

ノート：1. Spartan-6 FPGA ロジック セルの定格は、新しい 6 入力 LUT アーキテクチャによって提供されるロジック セルの能力の向上を反映しています。

2. 各 Spartan-6 FPGA スライスには 4 つの LUT と 8 つのフリップフロップが含まれています。

3. 各 DSP48A1 スライスには、18 x 18 乗算器、加算器、およびアキュムレータが含まれています。

4. ブロック RAM のサイズは基本的に 18 Kb です。各ブロックは、2 つの独立した 9 Kb ブロックとして使用することもできます。

5. 各 CMT には 2 つの DCM と 1 つの PLL が含まれています。

Spartan-6 FPGA デバイスとパッケージの組み合わせと利用可能な I/O

表 2: Spartan-6 デバイスとパッケージの組み合わせと利用可能な最大 I/O

ノート：

1. これらのパッケージのデバイスにはメモリ コントローラーがありません。

2. メモリ コントローラー ブロックのサポートは、CSG225 パッケージの XC6SLX9 および XC6SLX16 デバイスでは x8 です。XC6SLX4 にはメモリ コントローラーがありません。

3. これらのデバイスは、標準注文オプションとして、鉛パッケージと鉛フリー (追加 G) パッケージの両方で入手できます。

4. これらのパッケージは、XC6SLX75、XC6SLX75T、XC6SLX100、XC6SLX100T、XC6SLX150、および XC6SLX150T デバイスの 4 つのメモリ コントローラーのうち 2 つをサポートします。

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