EPM1270F256C5Nの集積回路はMAX II家族を即刻のの、不揮発性CPLDs欠く

MAX II家族は即刻のの、不揮発性CPLDsある

0.18-mに基づく

導入

MAX® II家族は即刻のの240からの2,210の論理素子（LEs） （128から2,210の同等のmacrocells）および8 Kbitsの持久記憶装置への密度の0.18-µm、6層金属フラッシュ プロセスに、不揮発性CPLDs、基づいている。MAX II装置は高い入力/出力の計算、速い性能および信頼できる付属品を対他のCPLDの建築提供する。プログラム可能な解決を調整（POR）パワーのバス、連結、入力/出力の拡張のような適用に提供している間および配列する制御およびデバイス・コンフィギュレーション制御をMultiVoltの中心を特色にして、ユーザーのフラッシュ・メモリ（UFM）のブロックおよび高められた内部システム プログラム可能性（ISP）、MAX II装置は費用および力を減らすように設計されている。

特徴

MAX II CPLDに次の特徴がある:

■低価格の、ローパワーCPLD

■即刻、不揮発性建築

■25 µAとして低いスタンバイの流れ

■速い伝搬遅延および時計に出力時間を提供する

■与える論理配列のブロック（実験室）ごとに利用できる2個の時計を4個の全体的な時計に

■持久記憶装置のためのUFMのブロック8までKbits

■MultiVoltの中心外的な供給電圧を3.3 V/2.5 Vか1.8 Vの装置に可能にする

■3.3-V、2.5-V、1.8-Vおよび1.5-V論理のレベルを支えるMultiVolt入力/出力インターフェイス

■プログラム可能なスルー・レート、ドライブ強さ、バス把握およびプログラム可能なプルアップの抵抗器を含むバスに適する建築

■Schmittは可能にを騒音の耐久性がある入力の誘発する（ピンごとにプログラム可能な）

■I/Osは周辺コンポーネントの結合の特殊利益団体（PCIのSIG） PCIのローカル バスの指定、66のMHzの3.3-V操作のための修正2.2に完全に準拠している

■熱いsocketingサポート

■IEEE Std. 1149.1-1990と迎合的な作り付けの共同テスト アクション・グループ（JTAG）境界スキャン テスト（BST）回路部品

■IEEE Std. 1532と迎合的なISPの回路部品

標準的な提供（熱い販売法）

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