敏捷なトランシーバーのプログラム可能な集積回路RF IC AD9361BBCZ

AD9361BBCZは無線周波数（RF）の敏捷なトランシーバー プログラム可能なICを統合した

記述

AD9361は高性能、非常に統合された無線周波数（3Gの使用のために設計されているRF）敏捷なTransceiver™および4G基地局の適用である。そのプログラム可能性およびワイドバンドの機能はそれをトランシーバーの塗布の広い範囲にとって理想的にさせる。装置はプロセッサへ構成可能のデジタル・インターフェイスを提供することによって設計で簡単にする適用範囲が広い混合され信号のベースバンド セクションおよび統合された頻度シンセサイザによってRFの前部分を結合する。AD9361受信機LOは70のMHzから6.0 GHzに作動し、送信機LOは47のMHzから範囲6.0 GHzのに作動し、最も認可され、最もライセンスのないバンド覆う。200以下のkHzまで56のMHzからのチャネルの帯域幅は支えられる。

2台の独立した直接転換の受信機に最新式の雑音指数および直線性がある。それぞれは（RX）サブシステムを含んでいる独立した自動利得制御（AGC）、dcを相殺した訂正、求積法の訂正、およびそれによりデジタル ベースバンドのこれらの機能のための必要性を除去するデジタルろ過を、受け取る。AD9361にまた外的に制御することができる適用範囲が広い手動利益モードがある。チャネルごとの2つの高いダイナミック レンジのアナログ・ディジタル変換器（ADCs）受け取られる私、Q信号をデジタル化し、適切なサンプル率で12ビット出力信号を作り出すために構成可能の殺害フィルターおよび128蛇口の有限なインパルス応答（もみ）フィルターを通して渡すため。

送信機は超低い騒音の高い調節正確さを達成する直接転換の建築を使用する。この送信機の設計はクラスTXの間違いのベクトル大きさ（EVM）のベストをの作り出す <>

十分に統合されたphase-lockedループ（PLLs）はすべてにチャネルを受け取り、送信するために低い電力の僅かNの頻度統合を提供する。周波数分割二重（FDD）システムによって要求されるチャネルの分離は設計に統合される。すべてのVCOおよびループ・フィルタの部品は統合される。

AD9361の中心は1.3ボルトの調整装置から直接動力を与えることができる。ICは標準的な4ワイヤー シリアル ポートおよび4つのリアルタイムの入出力制御ピンで制御される。広範囲のパワー モードは正常な使用の間にパワー消費量を最小にするために含まれている。AD9361は10のmmの×で10のmmの144ボールの破片のスケールのパッケージの球の格子配列（CSP_BGA）包まれる。

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