MC9S08LC60LKの集積回路の破片の新しい及びオリジナルのマイクロ制御回路

MC9S08LC60特徴

8ビットHCS08中央処理装置(CPU)

• 40 MHz HCS08 CPU
• 加えられたBGNDの指示を含むHC08命令セット
• 背景のダバッギング システム
• 回路内ダバッギングの間に単一の中断点の設定を許可する中断点の機能（オン破片の2つのより多くの中断点とモジュールをデバッグして下さい）
• 回路内エミュレーター(ICE)は2つのコンパレーターおよび9つの制動機モードを含んでいるモジュールをデバッグします。変更の流れの住所およびでき事だけデータを貯えるための8深い先入れ先出し法。氷はモジュール サポートを付け、強制します中断点にデバッグします。
• 32までのためのサポートは中断しましたり/再調節された源

記憶選択

• ブロックの保護および保証選択の二重オン破片の回路内プログラム可能なフラッシュ・メモリ;利用できる60Kおよび36K選択
• 別のものから実行している間1つの抜け目がない配列のプログラム/消去
• オン破片のRAMメモリ(RAM);利用できる4Kおよび2.5K選択

パワー セービングの特徴

• 3つの停止と待ち時間
• 最も低い停止流れのための時計のモニターおよび低電圧割り込み(LVI)のソフトウェア ディスエイブル
• ソフトウェア発生させた実時間時計(RTC)は実時間割り込み(RTI)を使用して作用します

構成可能の時計の源

• 時計の源の選択は精密不揮発性メモリの(NVM)のトリミングが付いている水晶、共鳴器、外的な時計、または内部的に発生させた時計を含んでいます
• 自動時計のモニター機能

システム保護

• (COP)の調整をきちんと作動させる任意コンピュータ
• 調整または割り込みの低電圧の検出
• 調整を用いる違法opcodeの検出

パッケージの選択

• 64ピン控えめなクォードの平らなパッケージ（LQFP）
• 80ピンLQFP

ペリフェラル

• LCD （液晶表示装置の運転者互換性がある） — 5-Vまたは3-V LCDガラスの表示と;待ち時間およびstop3ローパワー モードで機能;選択可能なfrontplaneおよびバックプレーン構成:
  • – 4 x 40か3 x 41 （80ピン パッケージ）
  • – 4 x 32か3 x 33 （64ピン パッケージ）
• ACMP （アナログのコンパレーター） —内部参照の電圧と比較するべき選択;出力は選択可能なソフトウェアTPM1チャネルの入力捕獲に運転されるために0です。
• ADC （アナログ・ディジタル変換器） — 8チャンネル、12 -自動のビットは機能、非同期時計の源、温度検出器および内部bandgapの参照チャネルを比較します。ADCはRTIのカウンターを使用してtriggerableハードウェアです。
• SCI （シリアル通信インターフェイス） —利用できる単一ワイヤー モード
• SPI1およびSPI2 — 2つの連続周辺機器インターフェイス モジュール
• KBI —ソフトウェア落ちる選択可能な上がるか、または端が付いている2つの8ピン キーボード割り込みモジュールは検出します
• IIC —操作の最高バス ローディングを用いる100までキロビット/秒が可能な相互統合された回路バス モジュール;減らされた負荷を用いるより高いbaudratesが可能
• TPM1およびTPM2 —選択可能な入力を持つ裏切り者/脈拍幅の変調器は捕獲します、出力は、および各チャネルの端一直線に並べられたPWMの機能比較します。各タイマー モジュールはすべてのチャネルの緩衝された、集中させたPWM （CPWM）のために形成されるかもしれません。

入出力

• 24までの一般目的入出力（入力/出力）ピン;2つの出力だけピンおよび1つの入力だけピンを含んでいます
• 入力として使用された場合港のソフトウェア選択可能な懸垂。選択は個々の港ビット基礎にあります。
• 出力として使用された場合ソフトウェア港の選択可能なたくさんの速度制御（選択は個々の港にかみました基礎をあります）
• 出力として使用された場合ソフトウェア港の選択可能なドライブ強さ制御（選択は個々の港にかみました基礎をあります）
• 顧客のシステム費用を削減する調整およびIRQピンの内部懸垂

絶対最高評価

1. 入力は指定される価値へ現在の限られなければなりません。必須現在制限抵抗器の価値を定めるためには、肯定的で、（VDD）否定的な（VSS）クランプ電圧のための抵抗の価値を計算し、そして2つの抵抗の価値のより大きいの使用して下さい。
2. すべての機能非供給ピンはVSSおよびVDDに内部的に締め金で止められます。
3. 電源は即時および作動の最高の現在の状態の間にVDDの範囲の作動の内の規則を維持しなければなりません。肯定的な注入流れ（VIn > VDD）がIDDより大きかったら、注入流れはVDDから流れるかもしれ、規則の外部電源の出かけることで起因してもよい。外的なVDDの負荷が現在の非常により最高の注入流れを回避することを保障して下さい。これはMCUが力を消費していない場合最も大きい危険です。例は次のとおりです:システム クロックがないか、または全面的なパワー消費量を減らすクロック レートが非常に低ければ。

80 Pin LQFPのパッケージの図1. MC9S08LC60シリーズ

64 Pin LQFPのパッケージの図2. MC9S08LC60シリーズ

注:V_{REFH/V REFLは}64ピン パッケージのV_{DDAD/V SSAD}に内部的に接続されます。

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