パワープログラマブルICチップXC6SLX100-3FGG484CのSpartan-6ファミリ概要

力プログラム可能な IC は XC6SLX100-3FGG484C スパルタ式6 家族の概観を欠きます

XC6SLX100-3FGG484C スパルタ式6 家族の概観

概説

Spartan®-6 家族は大量の適用に最も低い総額を一流のシステム統合の機能に与えます。 13 メンバー家族は 3,840 及ぶ拡大された密度から前のスパルタ式家族のパワー消費量半分のの 147,443 個の論理の細胞に、およびより速い、広範囲の結合性を提供します。 費用、力および性能の最適のバランスを提供する成長した 45 nm のローパワー銅の加工技術で造られて、スパルタ式6 家族は作り付けのシステム レベルのブロックの新しい、より有効な、二重記録の 6 入力参照用テーブル（LUT）の論理そして豊富な選択提供します。 これらは 18 の Kb （2 x 9 Kb）のブロックのラム、第二世代 DSP48A1 の切れ、SDRAM の記憶コントローラーを含んでいましたり、ミックス モードの時計管理ブロック、SelectIO™の技術、poweroptimized 高速連続トランシーバーのブロック、PCI Express® の多用性がある終点のブロック、高度のシステム レベル力管理モードを高めましたり、AES および装置 DNA の保護のコンフィギュレーション オプションおよび高められた IP の保証を自動検出します。 これらの特徴は前例のない使い易さを注文 ASIC プロダクトに低価格のプログラム可能な代わりに与えます。 大量の論理のための最もよい解決が設計する FPGAs のスパルタ式6 の提供、消費者志向の DSP は、費用に敏感な埋め込まれた適用設計し。 スパルタ式6 の FPGAs は彼らの開発サイクルが始まるとすぐデザイナーが革新に焦点を合わせることを可能にする統合ソフトおよびハードウェアを提供する目標とされた設計プラットホームのためのプログラム可能なケイ素の基礎です。 スパルタ式6 FPGA の概要

特徴

• スパルタ式6 家族:

• スパルタ式6 LX FPGA: 最大限に活用される論理

• スパルタ式6 LXT FPGA: 高速連続結合性

• 安価のために設計されている

• 多数の有効な統合されたブロック

• 入力/出力の標準の最大限に活用された選択

• ぐらつかせたパッド

• 大量のプラスチック ワイヤー担保付きのパッケージ

• 低く静的な、動的力

• 費用および低い電力のために最大限に活用される 45 nm プロセス

• ゼロ力のためのパワー モードは冬眠します

• モードを維持します国家を中断すればマルチピンの目覚しの構成は、強化を制御します

• ローパワー 1.0V 中心の電圧（LX だけ FPGAs、-1L）

• 高性能 1.2V の中心の電圧（LX および LXT FPGAs、-2 の、-3、および -4 の速度の等級）

• 複数の電圧、複数の標準的な SelectIO™インターフェイス銀行

• 差動入力/出力ごとの 1,050 まで Mb/s のデータ転送率

• 選択可能な出力ドライブ、ピンごとの 24 まで mA

• 1.2V 入力/出力の標準および議定書への 3.3V

• 低価格 HSTL および SSTL の記憶インターフェイス

• ホット スワップ承諾

• 信号の保全性を改善する調節可能な入力/出力のスルー・レート

• LXT FPGAs の高速 GTP の連続トランシーバー

• 3.125 まで Gb/s

• 高速インターフェイス

下記のものを含んでいること: 連続 ATA、オーロラ、1G、OBSAI 明白な、イーサネット、PCI CPRI、EPON、GPON、DisplayPort および XAUI • PCI の明白な設計（LXT）のための統合された終点のブロック • 33 の MHz、32 と互換性がある低価格 PCI® の技術サポート-および 64 ビットの指定。 • 有効な DSP48A1 切れ • 高性能算術および信号処理 • 18 x 18 乗数および 48 ビット蓄積装置は絶食します • 導管で送り、滝のように落ちる機能 • フィルター塗布を助ける前加算機 • 統合された記憶コントローラーのブロック • DDR、DDR2、DDR3 および LPDDR サポート • 800 Mb/s （12.8 Gb/s のピークの帯域幅）までのデータ転送速度 • 設計タイミングを減らす独立した先入れ先出し法の複数の港バス構造は出ます • 高められた論理容量の豊富な論理資源 • 任意シフト レジスタか分散 RAM サポート • 有効な 6 入力 LUTs は性能を改善し、力を最小にします • パイプラインの中枢的な塗布のための二重フリップフロップの LUT • 粒度の広い範囲との RAM を妨げて下さい • バイトの速いブロックの RAM は可能になります書きます • 2 独立者として 9 つの Kb のブロックのラム任意にプログラムすることができる 18 の Kb のブロック • 高められた性能のための時計管理タイル (CMT) • 低雑音、適用範囲が広い時間を記録すること • (DCMs) デジタル時計のマネージャーは時計のゆがみおよび使用率のゆがみを除去します • 低ジッターの時間を記録することのための段階ロックされたループ (PLLs) • 同時乗法、分割および段階の è」¢ç§」の頻度統合 • 16 の低ゆがみの全体的な時計ネットワーク • 簡単構成、サポート低価格の標準 • 2 ピンは構成を自動検出します • 広い第三者 SPI （x4 まで）および抜け目がないサポート • JTAG の機能が豊富な Xilinx のプラットホームのフラッシュ • 番犬の保護を使用して多数の bitstreams との遠隔改善のための MultiBoot サポート、 • 設計保護のための高められた保証 • 設計証明のための独特な装置 DNA の鑑定器 • より大きい装置の AES のビットストリームの暗号化 • 高められた、安価、MicroBlaze™の柔らかいプロセッサとのより速く埋め込まれた処理 • 工業一流 IP および参照の設計

スパルタ式6 FPGA の特徴の概要

表 1: 装置によるスパルタ式6 FPGA の特徴の概要

注: 1.スパルタ式6 FPGA の論理の細胞の評価は新しい 6 入力 LUT 建築によって提供される高められた論理の細胞の機能を反映します。

2. 各々のスパルタ式6 FPGA の切れは 4 LUTs および 8 つのフリップフロップを含んでいます。

3. 各 DSP48A1 切れは 18 x 18 乗数、加算機および蓄積装置を含んでいます。

4. ブロックのラムは基本的に 18 Kb です。 各ブロックはまた 2 独立者として 9 つの Kb のブロック使用することができます。

5. 各 CMT は 2 DCMs および 1 PLL を含んでいます。

スパルタ式6 FPGA の装置パッケージの組合せおよび利用できる I/Os

表 2: スパルタ式6 の装置パッケージの組合せおよび最高利用できる I/Os

注:

1. これらのパッケージの装置に記憶コントローラーがありません。

2. 記憶コントローラーのブロック サポートは CSG225 パッケージの XC6SLX9 および XC6SLX16 装置の x8 です。 XC6SLX4 に記憶コントローラーがありません。

3. これらの装置は Pb で利用でき、Pb なしです（標準的な命令の選択として付加的な G）パッケージ。

4. これらのパッケージは XC6SLX75、XC6SLX75T、XC6SLX100、XC6SLX100T、XC6SLX150 および XC6SLX150T 装置の 4 つの記憶コントローラーの 2 つを支えます。

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