SN65LVDS100DR LVDSバッファ/ドライバ 400Mbpsデータレート 3.3V電源 100Ω内部終端 SOIC-8 -40°C～+85°C

SN65LVDS100DR LVDSバッファ/ドライバ 400Mbpsデータレート 3.3V電源 100Ω内部終端 SOIC-8 -40°C～+85°C

特徴

• 2 Gbps以上の信号レート向けに設計1

• 合計ジッタ< 65 ps

• MC100EP16の低電力代替品

• 低100 ps（最大）部品間スキュー

• 0V～4V入力電圧範囲で25mVのレシーバ入力スレッショルドヒステリシス

• 入力はLVPECL、CML、LVDS信号レベルと電気的に互換性があります

• 3.3V電源動作

• LVDTは110Ω終端抵抗を内蔵

• SOICおよびMSOPで提供

アプリケーション

• 無線インフラ

• テレコムインフラ

• プリンタ

説明

SN65LVDS100、SN65LVDT100、SN65LVDS101、SN65LVDT101は、リピータとして接続された高速差動レシーバおよびドライバです。レシーバは、最大2 Gbpsのレートで低電圧差動信号（LVDS）、正エミッタ結合ロジック（PECL）、または電流モードロジック（CML）入力信号を受け入れ、LVDSまたはPECL出力信号として繰り返します。デバイスを通る信号経路は差動であり、放射エミッションが少なく、ジッタが最小限に抑えられます。

SN65LVDS100およびSN65LVDT100の出力は、TIA/EIA-644-Aで定義されているLVDSレベルです。SN65LVDS101およびSN65LVDT101の出力は、3.3V PECLレベルと互換性があります。どちらも、公称100Ωの特性インピーダンスを持つ差動伝送線を駆動します。

SN65LVDT100およびSN65LVDT101には、基板スペースを削減し、コンポーネント数を減らし、最短のスタブ長を実現するための110Ω差動ライン終端抵抗が含まれています。SN65LVDS100およびSN65LVDS101にあるVBB電圧リファレンスは含まれていません。VBBは、シングルエンド入力信号の受信に使用するVCCの下1.35Vの電圧リファレンスを提供し、シングルエンド3.3V PECL入力で特に役立ちます。VBBを使用しない場合は、未接続またはオープンにする必要があります。

すべてのデバイスは、-40°C～85°Cでの動作が特徴です。

情報

図面

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