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格子Certus-NX FPGAsは明白なPCIを含むいろいろなインターフェイスを、（Gen1、Gen2）、SGMII （ギガビットのイーサネット）、LVDS、LVCMOS （0.9V-3.3V）支える。装置の特徴を処理して39k論理の細胞、56の18の× 18の乗数、埋め込まれた記憶（EBRおよびLRAMのブロックから成っている）、分散記憶、ドラムの2.9Mbまでインターフェイスする含んで（1066Mbps × 16データ幅までの支持DDR3、DDR3L、LPDDR2およびLPDDR3）。FPGAsに再構成可能なSRAMベースの論理の生地の速い構成およびプログラム可能なsysI/O™の超高速構成が（3msの下で）ある。FD-SOIの技術に（極端に低いSERによる）固有高い信頼性に加えて作り付けのフレーム ベースのSED/SECのような動作信頼度の特徴（SRAMベースの論理の生地のために）およびECCはまた（EBRおよびLRAMのために）支えられる。二重12ビットADCsはシステム・モニタリング機能のための利用できるオン破片である。
多くの前設計されたIP （知的財産）モジュールはCertus-NX家族のために提供される。標準化されたブロックとしてこれらの構成可能の柔らかいIPの中心の使用によって、ユーザーは生産性を高める設計の特徴に集中して自由である。
