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クールランナー XPLA3プログラム可能なICの破片CPLD XCR3128XL-7VQ100I

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シティ:shenzhen
国/地域:china
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クールランナー XPLA3プログラム可能なICの破片CPLD XCR3128XL-7VQ100I

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型式番号 :XCR3128XL-7VQ100I
原産地 :元の製造業者
最低順序量 :最低順序量: 10 PCS
支払の言葉 :先立ってT/T、ウェスタン・ユニオン、Xtransfer
供給の能力 :1000
受渡し時間 :3daysの中では
包装の細部 :標準的な包装
製造業者部品番号 :XCR3128XL-7VQ100I
タイプ :集積回路
記述 :元で新しい
船積み :3daysの中では
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プログラム可能なICの破片XCR3128XL-7VQ100I- XILINX - クールランナー XPLA3 CPLD

 

高いライト:

プログラム可能なICの破片

集積回路の破片

 

 


速い細部:

クールランナー XPLA3 CPLD


記述:

CPLDsのクールランナー XPLA3 (延長プログラマブル・ロジック・アレイ)の系列は携帯用を、手持ち型含んでいる、および力の敏感な適用目標とされる低い電力システムのために。クールランナー XPLA3家族の各メンバーは低い電力および高速を結合する速いゼロ力(FZP)のデザイン技術を含んでいる。このデザイン・テクニックによって、クールランナー XPLA3家族は同時に「ターボ ビット」または他の力の機構のための必要性なしにスタンバイに56 μWよりより少し下がる力を提供している間5.0 nsの本当ピンにピン速度を、提供する。純粋なCMOSのゲートの滝のように落とされた鎖とプロダクト言葉(技術)を両極時代以来のPLDsで使用された実行するための慣習的な感覚のアンプ方法を取り替えることによって、動的力はまた他のどのCPLDもより大幅に低い。クールランナー装置はCMOSの加工技術および特許を取られた完全なCMOS FZPのデザイン・テクニックを両方使用するので、唯一のTotalCMOS PLDsである。FZPのデザイン・テクニックは超低い力SRAMのシャドウ メモリと企業で低い電力3.3V CPLD家族を分娩するために速い不揮発性メモリの細胞を結合する。
クールランナー XPLA3家族は機能ブロック内の論理の割振りのための完全なPLAの構造を用いる。PLAは機能を締める優秀なピンを決定論のタイミングを維持している間最大自在性および論理密度に、与える。
クールランナー XPLA3 CPLDsはXilinx® WebPACK™ソフトウェアおよび業界標準CAE用具(顧問、調子/OrCAD、見本の論理、Synopsys、ビューロジックおよびアベルが付いているHDLの編集者を使用してシンプリシティ)によって、VHDLおよびVerilog、および/または図式的な捕獲の設計記入項目支えられる。
設計証明は機能およびタイミングのシミュレーションのために業界標準のシミュレーターを使用する。開発は多数パーソナル コンピュータ(PC)、日曜日およびHPのプラットホームで支えられる。
クールランナー XPLA3家族の特徴はまたどの装置の境界スキャン テスト、内部システム プログラミングが(ISP)、および起こるプログラムし直すことことができるか業界標準を、IEEE 1149.1のによるJTAGインターフェイス含んでいる。クールランナー XPLA3 CPLDは業界標準装置プログラマーを使用して電気でreprogrammableである。


適用:

•速いゼロ力(FZP)のデザイン・テクニックは超低い力およびまさに高速を提供する
- 25°Cの17から18 μAの典型的なスタンバイの流れ
•クールランナー™革新的なXPLA3の建築は極度な柔軟性と高速を結合する
•企業の最初TotalCMOS PLDに基づく—CMOSの両方設計および加工技術
•高度0.35μ 5層の金属EEPROMプロセス
- 1,000の消去/業務計画周期は保証した
- 保持20年はデータ保証した
•3VのJTAG IEEE 1149.1インターフェイスを使用して(ISP)プログラム可能な内部システム
- 完全な境界スキャン テスト(IEEE 1149.1)
- 速いプログラミングの時
•複雑な非同期に時間を記録することのためのサポート
- 機能ブロックごとの16個のプロダクト言葉の時計そして4個の局域内制御の言葉の時計
- 装置ごとの4個の全体的な時計そして1個の普遍的な制御言葉の時計
•設計変更の間の優秀なピン保持
•商業用等級および延長電圧(2.7Vへの3.6V)産業等級で利用できる
•5V耐久性がある入力/出力ピン
•入れられた記録は2.5 nsの設定時間を
•48のプロダクト言葉に拡張できる単一パスの論理
•5.0 nsの高速ピンにピン遅れ
•出力ごとの速度制御を殺害した
•routable 100%
•保証ビットは不正アクセスを防ぐ
•機能を熱差し込むサポート
•Xilinxまたは業界標準CAE用具を使用して設計記入項目/証明
•革新的な制御言葉の構造は提供する:
- 非同期にmacrocellの時間を記録すること
- 非同期macrocellは事前調整/調整を登録する
- 時計はmacrocellごとの制御を可能にする
•4出力機能ブロックごとの制御を可能にするため
•統合の最適化のためのFoldback否定論履積
•「テストする釘のベッド」を促進する普遍的な3州
•破片スケールBGA、Fineline BGAおよびQFPのパッケージで利用できる。ほとんどのパッケージのタイプのためのPbなしの利用できる。


指定:

部品番号。 XCR3128XL-7VQ100I
製造業者 xilinx
供給の能力 10000
日付コード 10+
パッケージ MSOP
注目 新しく、元の在庫
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